AT89S52-24AI 车载主控
价格：8.50起
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行 业：电子 电子有源器件 专用集成电路
发布时间：2021-06-14
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Scaler Register (Bank=00, Registers 01h ~ 9Fh)
Index Name Bits Description
TRGC 1 Trigger Condition.
0: Active low for level trigger/tailing edge trigger.
1: Active high for level trigger/leading edge trigger.
INT_TRIG 0 Interrupt Trigger.
0: Generate an edge trigger interrupt.
1: Generate a level trigger interrupt.
17h INTPULSE 7:0 Default : 0x0F Access : R/W
INTPULSE[7:0] 7:0 Interrupt Pulse width by reference clock.
18h INTSTA 7:0 Default : 0x00 Access : R/W
INTSTA[7:0] 7:0 Interrupt Status byte A.
Bit 7: MVD input NOT “no signal”.
Bit 6: MVD “HSYNC lock”.
Bit 5: MVD NOT “no color”.
Bit 4: MVD degree error.
Bit 3: MVD input “no signal”.
Bit 2: MVD NOT “HSYNC lock”.
Bit 1: MVD “no color”.
Bit 0: MVD HSYNC change.
19h INTENA 7:0 Default : 0x00 Access : R/W
INTENA[7:0] 7:0 Interrupt Enable control byte A.
0: Disable interrupt.
1: Enable interrupt.
1Ah INTSTB 7:0 Default : 0x00 Access : R/W
INTSTB[7:0] 7:0 Interrupt Status byte B.
Bit 7: MCU D2B interrupt 2.
Bit 6: MCU D2B interrupt 1.
Bit 5: MCU D2B interrupt 0.
Bit 4: MVD CC interrupt.
Bit 3: MVD SECAM detect.
Bit 2: MVD PAL switch error.
Bit 1: MVD “ADC7_0ACT”.
Bit 0: MVD NOT “ADC7_0ACT”.
1Bh INTENB 7:0 Default : 0x00 Access : R/C
INTENB[7:0] 7:0 Interrupt Enable control byte B.
0: Disable interrupt.
1: Enable interrupt.
1Ch INTSTC 7:0 Default : 0x00 Access : R/W
Sigmastar Confidential for
芯智国际有限公司
Internal Use Only
Security Level: Confidential A
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Scaler Register (Bank=00, Registers 01h ~ 9Fh)
Index Name Bits Description
INTSTC[7:0] 7:0 Interrupt Status byte C.
Bit 7: Output VSYNC interrupt.
Bit 6: Input VSYNC interrupt.
Bit 5: ATG ready interrupt.
Bit 4: ATP ready interrupt.
Bit 3: ATS ready interrupt.
Bit 2: MVD probe ready interrupt.
Bit 1: MCU D2B interrupt 4.
Bit 0: MCU D2B interrupt 3.
1Dh INTENC 7:0 Default : 0x00 Access : R/C
INTENC[7:0] 7:0 Interrupt Enable control byte C.
0: Disable interrupt.
1: Enable interrupt.
1Eh INTSTD 7:0 Default : 0x00 Access : R/W
INTSTD[7:0] 7:0 Interrupt Status byte D.
Bit 7: WDT interrupt.
Bit 6: Keypad wake-up interrupt.
Bit 5: Jitter interrupt.
Bit 4: Horizontal total change interrupt.
Bit 3: Vertical total change interrupt.
Bit 2: Horizontal lost count interrupt.
Bit 1: Vertical lost count interrupt.
Bit 0: Standard change interrupt.
1Fh INTEND 7:0 Default : 0x00 Access : R/C
INTEND[7:0] 7:0 Interrupt Enable control byte D.
0: Disable interrupt.
1: Enable interrupt.
20h ~
21h
- 7:0 Default : - Access : -
- 7:0 Reserved.
22h MPL_M 7:0 Default : 0x6F Access : R/W
MP_ICTRL[2:0] 7:5 Charge pump current set.
MPL_M[4:0] 4:0 MPLL divider ratio setting.
23h OPL_CTL0 7:0 Default : 0x40 Access : R/W
- 7:6 Reserved.
_EN 6 Output PLL spread spectrum.
0: Disable.
1: Enable
内存（RAM） 128MB DDRII
闪存（FLASH Memory） 大支持8GB/Up to 8G
外部存储（External Memory） SD(SDHC)
操作系统（OS） Wince6.0
显示（Display） 800*480Pixels
音频（Audio Format） mp3/wma
视频（Video Format） mpeg.rmvb.rav.wmv.asf.avi.3gp.mp4.dat.mov
图片（Picture Format） ipg.png.gif.bmp
视频输出（Video Output） 数字RGB
声音输出（Audio Output） 四声道
视频输入（Video Iutput） CVBS.Y/C.YUV
声音输入（Audio Iutput） 双声道立体声/Dual track stereo speaker system
收音机（Radio） FM/AM.RDS
蓝牙（Bluetooth） 内置蓝牙免提，蓝牙音乐，电话本
数字电视（Digital TV） CMMB.ISDB-T
操作界面（UI） 多套操作界面可选，也可定制
手机互联（Phone Link） 支持手机三星.HTC.LG.SONY系列等等主流手机
DVD格式（DVD Format
The TC90195AXBG incorporates a frame memory to display two independent pictures. It can display two asynchronous video signals simultaneously and overlay graphics signals from a system-on-a-chip (SoC) on video signals.
The TC90175XBG new product is a single-video processor without a frame memory. Both the TC90195AXBG and the TC90175XBG incorporate a video decoder, support various analog and digital video input formats, and allow optimal picture adjustment according to the specific LCD panel. The output stage has a T-Con, which adapts to LCD panels from multiple manufacturers.
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